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终端电阻的校准，需要通过如图3所示的RTUN模块来实现。它的原理是利用片外精细电阻对片内电阻进行校准。基准电路产生的基准电压vba(1.2V)经过buffer在片外6.04K电阻上产生电流，用同样大小的电流ires流经片内电阻产生电压与rex-tv(1.2V)进行比较，观察比较器的输出。通过setrd来控制W这三个开关，从000到111扫描，再从111到000扫描，改变片内电阻大小，观察比较器输出cmpout信号的变化，从而得到使得片内电阻接近6.04K的控制字。图2中的比较器终端电阻采用与该模块相同类型的电阻，以及成比例的电阻关系。当RTUN模块完成校准后，得到的控制字setrd同时控制比较器的终端电阻，从而使得比较器终端电阻接近100欧姆。数字示波器使用及MIPI-DSI信号测量;河南MIPI测试推荐货源

数据通路[D0:D3]的D0通路是双向通路，用于总线周转(BTA)功能。在主发射机要求外设响应时，它会在传输的数据包时向其PHY发出一个请求，告诉PHY层在传输结束(EoT)后确认总线周转(BTA)命令。其余通路和时钟都是单向的，数据在不同通路中被剥离。例如，个字节将在D0上传送，然后第二个字节将在D1上传送，依此类推，第五个字节将在D0上传送。根据设计要求，数据通路结构可以从一路扩充到四路。图3是1时钟3路系统上的数据剥离图。每条通路有一个的传输开始(SoT)和传输结束(EoP)，SoT在所有通路之间同步。但是，某些通路可能会在其他通路之前先完成HS传输(EoT)。黑龙江MIPI测试推荐货源时钟线的HS信号质量测试；

(3)HS信号电平判决和建立/保持时间容限(GROUP3:HS-RXVOLTAGEANDSETUP/HOLDREQUIREMENTS):其中包含了被测件对于HS信号共模电压、差分电压、单端电压、共模噪声、建立/保持时间的容限测试等。(TestIDs:2.3.1，2.3.2,2.3.3,2.3.4，2.3.5，2.3.6，2.3.7.2.3.8)

(4)HS信号时序容限测试(GROUP4:HS-RXTIMERREQUIREMENTS):其中包含了对于HS和LP间状态切换时的一系列时序参数的容限测试。(TestIDs;2.4.1，2.4.22.4.3，2.4.4，2.4.5，2.4.6,2.4.7,2.4.8,2.4.9,2.4.10,2.4.11)

D-PHY的接收端测试中，需要用到多通道的码型发生以产生多通道的D-PHY的信号，码型发生器需要在软件的控制下改变HS/LP信号的电平、偏置、注入噪声、改变时序关系等。图13.13是以Agilent公司的81250并行误码仪平台构建的一套D-PHY信号的接收容限测试系统。

2，MIPID-PHY测试项目

(1)DataLaneHS-TXDifferentialVoltages

(2)DataLaneHS-TXDifferentialVoltageMismatch

(3)DataLaneHS-TXSingle-EndedOutputHighVoltages(

4)DataLaneHS-TXStaticCommon-ModeVoltages

(5)DataLaneHS-TXStaticCommon-ModeVoltageMismatchΔV_CMTX(1,0)

(6)DataLaneHS-TXDynamicCommon-LevelVariationsBetween50-450MHz

(7)1.3.10DataLaneHS-TXDynamicCommon-LevelVariationsAbove450MHz

(8)DataLaneHS-TX20%-80%RiseTime

(9)DataLaneHS-TX80%-20%FallTime

(10)DataLaneHSEntry:T_LPXValue

(11)DataLaneHSEntry:T_HS-PREPAREValue

(12)DataLaneHSEntry:T_HS-PREPARE+T_HS-ZEROValue

(13)DataLaneHSExit:T_HS-TRAILValue

(14)DataLaneHSExit:30%-85%Post-EoTRiseTimeT_REOT

(15)DataLaneHSExit:T_EOTValue

(16)DataLaneHSExit:T_HS-EXITValue

(17)HSEntry:T_CLK-PREValue

(18)HSExit:T_CLK-POSTValue

(19)HSClockRisingEdgeAlignmenttoFirstPayloadBit

(ata-to-ClockSkew(T_SKEW[TX])

(21)ClockLaneHSClockInstantaneous:UI_INSTValue

(22)ClockLaneHSClockDeltaUI:(ΔUI)Value 什么是mipi一致性测试；

电路结构

在高速模式下，主机端的差分发送模块以差分信号驱动互连线，高速通道上呈现两种状态，differentia-0differential-1，从属端的高速接收单元将低摆幅的差分数据通过高速比较器转换成逻辑电平。在串行转并行模块中，高速时钟对数据进行双沿采样，将高速串行数据转换成两路并行数据，交给后续数字电路处理。高速接收单元的总体电路结构。

输入终端电阻由于输入数据信号频率高，需要进行阻抗匹配，因此在比较器的差分输入端dp/dn之间跨接了100欧姆终端电阻，由开关进行控制，当系统要进行高速数据传输时，就将该终端电阻使能。由于电阻值随工艺角、温度笔变化比较大，因此在终端电阳RO(50欧姆)的其础上增加了一个电阳，分别由三位控制信号控制，可通过改变控制字改变电阻大小，使终端电阻值在各工艺角及温度下均能满足协议要求。比较器终端电阻电路结松。 MIPI LCD 的CLK时钟频率与显示分辨率及帧率的关系;设备MIPI测试保养

Global Operation的测试；河南MIPI测试推荐货源

MIPI D-PHY的接收端容限测试

除了对于D-PHY设备的发送的信号质量有要求以外，MIPI协会还规定了对于接收端的容限要求，D-PHY的CTS规定的接收端的测试项目主要包含以下几个部分。

(1)LP信号电平和时序的判决容限(GROUP1:LP-RXVOLTAGEANDTIMINGREQUIREMENTS):其中包含了被测件对于LP信号高电平、低电平的判决阈值和容限对于脉冲宽度的判决容限测试等。(TestIDs:2.1.1，2.1.22.1.3,2.1.4,2.1.5.2.1.6，2.1.7，2.1.8)

(2)LP状态下的指令时序判决容限(GROUP2:LP-RXBEHAVIORALREQUIREMENTS):其中包含了被测件在LP状态下对于初始化、唤醒、Escape模式切换指令时序的判决容限测试等。(TestIDs:2.2.1，2.2.2,2.2.3，2.2.4，2.2.5,2.2.6,2.2.7，2.2.8) 河南MIPI测试推荐货源

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